標簽 > vhdl源代碼
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VHDL是一種用于電路設計的高級語言。出現(xiàn)在80年代的后期,最初是由美國國防部開發(fā)出來供美軍用來提高設計的可靠性和縮減開發(fā)周期的一種使用范圍較小的設計語言 。VHDL主要用于描述數(shù)字系統(tǒng)的結構,行為,功能和接口。除了含有許多具有硬件特征的語句外,VHDL的語言形式、描述風格以及語法是十分類似于一般的計算機高級語言。
4.9-5.9 GHz SPDT 開關, 750 至 770 MHz 線性功率放大 1710-1950 MHz 可變增益放大 814-849 MHz 高線性度、有源偏 699 至 748 MHz 高線性度、有 1.710-1.785 GHz 高線性度 1850-1915 MHz 高線性度、有 40 MHz 至 1 GHz 寬帶 75 具有旁路模式的 40 MHz 至 1 G 中帶 1805 至 2170 MHz 低 850 至 920 MHz、19 dBm 700 至 800 MHz、19 dBm
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