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      標(biāo)簽　>　fifo

      fifo

      +關(guān)注3人關(guān)注

      First Input First Output的縮寫，先入先出隊列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

      文章：267個 瀏覽：45377次 帖子：783個

      fifo技術(shù)

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      2023-05-19 標(biāo)簽：轉(zhuǎn)換器adcfifo 1k 0

      跨時鐘域電路設(shè)計：多位寬數(shù)據(jù)通過FIFO跨時鐘域

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      2023-05-11 標(biāo)簽：電路設(shè)計fifo信號 4.6k 0

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      隨著大數(shù)據(jù)的興起以及信息技術(shù)的快速發(fā)展，數(shù)據(jù)傳輸對總線帶寬的要求越來越高，并行傳輸技術(shù)的發(fā)展受到了時序同步困難、信號偏移嚴(yán)重，抗干擾能力弱以及設(shè)計復(fù)雜度...

      2023-05-10 標(biāo)簽：收發(fā)器濾波器FPGA設(shè)計 2.5k 0

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      摘要：本文在探討傳統(tǒng)數(shù)據(jù)收發(fā)不足之后，介紹如何使用帶FIFO的串口來減少接收中斷次數(shù)，通過一種自定義通訊協(xié)議格式，給出幀打包方法；之后介紹一種特殊的串口...

      2023-05-10 標(biāo)簽：單片機(jī)cpuRS485 2.6k 0

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      2023-05-06 標(biāo)簽：控制器CAN通信fifo 854 0

      FPGA設(shè)計原則總結(jié)

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      這里的面積指一個設(shè)計消耗 FPGA/CPLD 的邏輯資源的數(shù)量，對于 FPGA 可以用消耗的 FF(觸發(fā)器)和 LUT(查找表)來衡量，更一般的衡量方式...

      2023-05-04 標(biāo)簽：fifoVerilogHDL 906 0

      怎樣設(shè)計一個同步FIFO？（3）

      怎樣設(shè)計一個同步FIFO？（3）

      我們說這個結(jié)構(gòu)之所以使得FIFO的輸出Q在讀完SRAM之后保持穩(wěn)定，其實需要SRAM本身可以保持RDATA在讀操作之后的多個周期保持穩(wěn)定。即SRAM本身...

      2023-05-04 標(biāo)簽：sramfifo 1k 0

      怎樣設(shè)計一個同步FIFO？（2）

      怎樣設(shè)計一個同步FIFO？（2）

      開始往下讀之前，老李先問一個問題，假如現(xiàn)在讓你設(shè)計一個深度為N的基于2port SRAM的同步FIFO，請問至少需要多大的SRAM？ 假設(shè)SRAM的位寬...

      2023-05-04 標(biāo)簽：數(shù)據(jù)sramfifo 1.6k 0

      怎樣設(shè)計一個同步FIFO？（1）

      今天咱們開始聊聊FIFO的設(shè)計。FIFO是一個數(shù)字電路中常見的模塊，主要作用是數(shù)據(jù)產(chǎn)生端和接受端在短期內(nèi)速率不匹配時作為數(shù)據(jù)緩存。FIFO是指First...

      2023-05-04 標(biāo)簽：fifo數(shù)字電路數(shù)據(jù)緩存 1.4k 0

      介紹使用FIFO和DMA搭配的方式及運作原理

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      在單片機(jī)或者是嵌入式編程中，通常軟件和硬件是緊密相連的。編程者需要同時擁有硬件思維和軟件技巧，才能使程序更高效、更穩(wěn)定的運行在嵌入式系統(tǒng)中。

      2023-05-04 標(biāo)簽：單片機(jī)嵌入式fifo 4.6k 0

      網(wǎng)卡的Ring Buffer詳解

      DMA 將 NIC 接收的數(shù)據(jù)包逐個寫入 sk_buff ，一個數(shù)據(jù)包可能占用多個 sk_buff , sk_buff 讀寫順序遵循FIFO（先入先出）原則。

      2023-04-04 標(biāo)簽：網(wǎng)卡fifo函數(shù) 1.8k 0

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      FIFO（First In First Out）是異步數(shù)據(jù)傳輸時經(jīng)常使用的存儲器。該存儲器的特點是數(shù)據(jù)先進(jìn)先出（后進(jìn)后出）。其實，多位寬數(shù)據(jù)的異步傳輸問...

      2023-03-26 標(biāo)簽：存儲器fifo計數(shù)器 4.5k 0

      使用SVA的幾個好處

      SVA支持多時鐘域（clock domain crossing (CDC)）邏輯，例如異步FIFO。 2. SVA是一種描述語言，可讀性比較強(qiáng)。

      2023-03-21 標(biāo)簽：fifoCDC異步 1.1k 0

      AQS的同步組件有哪些呢？

      AQS 的全稱為 Abstract Queued Synchronizer，是在 JUC（java.util.concurrent）下子包中的類。

      2023-03-16 標(biāo)簽：fifoAPITCLH 879 0

      簡單介紹GaussDB網(wǎng)絡(luò)調(diào)度涉及的調(diào)度算法

      QoS（Quality of Service）即服務(wù)質(zhì)量，是一種調(diào)度控制機(jī)制，是網(wǎng)絡(luò)設(shè)計和運維的重要技術(shù)。

      2023-03-13 標(biāo)簽：QoSfifo調(diào)度器 1.4k 0

      Linux管道和FIFO應(yīng)用筆記

      從上圖可以看出，可以將管道看成是一組水管，它允許數(shù)據(jù)從一個進(jìn)程流向另一個進(jìn)程，這也是管道名稱的由來。

      2023-03-13 標(biāo)簽：Linuxfifo命令 1.2k 0

      在icestick板子上實現(xiàn)從FPGA到USB Host的數(shù)據(jù)傳輸

      icestick 板載 USB 接口芯片 FT2232H 的端口 A 和端口 B 均與 FPGA ice40hx1k 相連。

      2023-03-09 標(biāo)簽：fpgausbfifo 2.4k 0

      英飛凌TC3XX MCAL CAN模塊簡析

      英飛凌的芯片在汽車電子里用得可謂是頗多，剛好小編也用過，最近剛好在摸TC3系列的CAN模塊，剛好簡單寫寫。

      2023-03-07 標(biāo)簽：寄存器RAMfifo 3.9k 0

      Synwit SWM系列單片機(jī)的UART FIFO詳解

      如何配合接收門限中斷、接收超時中斷完成UART數(shù)據(jù)接收。

      2023-03-03 標(biāo)簽：芯片單片機(jī)fifo 2k 0

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      • Protues
        Protues
        +關(guān)注
        Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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        FPGA芯片
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        FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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        pcb封裝就是把 實際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進(jìn)行調(diào)用。
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        　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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        面包板
        +關(guān)注
        面包板是由于板子上有很多小插孔，專為電子電路的無焊接實驗設(shè)計制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
      • 特性阻抗
        特性阻抗
        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • 時鐘源
        時鐘源
        +關(guān)注
        時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英 晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
      • AD采樣
        AD采樣
        +關(guān)注
        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
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        驅(qū)動電流
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        Kintex-7
        +關(guān)注
        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實現(xiàn)與其相當(dāng)性能，性價比提高了一倍，功耗降低了一半。
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        +關(guān)注
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