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      標(biāo)簽　>　eda工具

      eda工具

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      EDA工具軟件可大致可分為芯片設(shè)計(jì)輔助軟件、可編程芯片輔助設(shè)計(jì)軟件、系統(tǒng)設(shè)計(jì)輔助軟件等三類(lèi)。進(jìn)入我國(guó)并具有廣泛影響的EDA軟件是系統(tǒng)設(shè)計(jì)軟件輔助類(lèi)和可編程芯片輔助設(shè)計(jì)軟件：Protel、PSPICE、multiSIM10（原EWB的最新版本）、OrCAD、PCAD、LSIIogic、MicroSim，ISE，modelsim等等。

      文章：261個(gè) 瀏覽：33660次 帖子：9個(gè)

      eda工具技術(shù)

      介紹SystemVerilog幾種常用的調(diào)試功能

      可視化調(diào)試主要分為Post-process和Interactive這兩種模式?？梢暬{(diào)試工具是工程師在定位代碼問(wèn)題時(shí)的有力工具，也是現(xiàn)在驗(yàn)證工程師主流的...

      2023-01-09 標(biāo)簽：EDA工具VCSDUT 4.1k 0

      coverpoint是什么意思

      “oc”是Coverpoint的名稱?！畂c’覆蓋了2比特變量‘offset’。由于沒(méi)有指定收集哪些bin，EDA仿真工具會(huì)默認(rèn)為我們創(chuàng)建4個(gè)bin(a...

      2022-11-14 標(biāo)簽：EDA工具BIN文件 3.3k 0

      分享一款非常好的項(xiàng)目Raven

      當(dāng)然也不是任何人都能參加這個(gè)項(xiàng)目，要想搭上流片的便車(chē)還需要滿足一些條件，比如必須采用SkyWater 的Open PDK(130nm)

      2022-10-31 標(biāo)簽：EDA工具SoC芯片 1.5k 0

      為什么要設(shè)置process node

      隨著先進(jìn)工藝已經(jīng)進(jìn)入到3nm階段，EDA工具對(duì)Delay計(jì)算的準(zhǔn)確度變得十分具有挑戰(zhàn)性

      2022-10-25 標(biāo)簽：EDA工具Cadence 1.8k 0

      可以用captable代替qrcTechfile文件嗎

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      2022-10-10 標(biāo)簽：EDA工具 3.5k 0

      如何又快又好的梳理和利用驗(yàn)證feature文檔

      我們不再繼續(xù)細(xì)化贅述，相信大家從舉例中已經(jīng)有點(diǎn)感覺(jué)了，什么叫“粗”，什么叫“細(xì)”，這里說(shuō)到的粗細(xì)，其實(shí)就是指的是驗(yàn)證feature的顆粒度。

      2022-10-09 標(biāo)簽：FPGA設(shè)計(jì)EDA工具中斷 1.5k 0

      Vivado在FPGA設(shè)計(jì)中的優(yōu)勢(shì)

      Xilinx的新一代設(shè)計(jì)套件Vivado相比上一代產(chǎn)品ISE，在運(yùn)行速度、算法優(yōu)化和功能整合等很多方面都有了顯著地改進(jìn)。但是對(duì)初學(xué)者來(lái)說(shuō)，新的約束語(yǔ)言X...

      2022-09-19 標(biāo)簽：fpgaFPGA設(shè)計(jì)EDA工具 2.1k 0

      將PCB原理圖傳遞給版圖設(shè)計(jì)時(shí)需要考慮的六件事

      如果原理圖中有個(gè)器件沒(méi)有封裝，會(huì)彈出一條告警消息，指示虛擬元件無(wú)法被導(dǎo)出。在這種情況下，沒(méi)有默認(rèn)的封裝信息會(huì)傳遞到版圖，元件將從版圖中簡(jiǎn)單地刪除掉。

      2022-08-31 標(biāo)簽：原理圖pcbEDA工具 660 0

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      Sequential equivalence被某些EDA工具稱之為周期精確等價(jià)（cycle-accurate equivalence），名字不重要，關(guān)鍵...

      2022-07-19 標(biāo)簽：EDA工具SPECIMP 1.4k 0

      robei EDA簡(jiǎn)介Robei可視化EDA工具

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      作者丨Robei君? 圖片 | Robei 沒(méi)有EDA，就沒(méi)有芯片，EDA是造芯的工具。 如果沒(méi)有EAD軟件，可能全球所有的芯片設(shè)計(jì)公司都得停擺，代工廠...

      2021-01-05 標(biāo)簽：芯片EDA工具芯片設(shè)計(jì) 7.4k 0

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      2019-10-15 標(biāo)簽：PCB板EDA工具多層電路板 5.9k 0

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      電路板尺寸和布線層數(shù)需要在設(shè)計(jì)初期確定。如果設(shè)計(jì)要求使用高密度球柵數(shù)組（BGA）組件，就必須考慮這些器件布線所需要的最少布線層數(shù)。布線層的數(shù)量以及層疊（...

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      如何設(shè)計(jì)出不規(guī)則形狀的PCB電路板

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      然而，當(dāng)電路板外形需要適應(yīng)具有高度限制的復(fù)雜外殼時(shí)，對(duì)于 PCB 設(shè)計(jì)人員來(lái)說(shuō)就沒(méi)那么容易了，因?yàn)檫@些工具中的功能與機(jī)械 CAD 系統(tǒng)的功能并不一樣。圖...

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      如何提升PCB設(shè)計(jì)過(guò)程中的布線效率

      電路板尺寸和布線層數(shù)需要在設(shè)計(jì)初期確定。如果設(shè)計(jì)要求使用高密度球柵數(shù)組（BGA）組件，就必須考慮這些器件布線所需要的最少布線層數(shù)。布線層的數(shù)量以及層疊（...

      2019-04-15 標(biāo)簽：eda工具pcb設(shè)計(jì) 1.1k 0

      PCB原理圖傳遞給版圖設(shè)計(jì)時(shí)需要考慮的六件事

      下面是為版圖設(shè)計(jì)階段準(zhǔn)備的一些推薦步驟： 1. 將柵格和單位設(shè)置為合適的值。為了對(duì)元器件和走線實(shí)現(xiàn)更加精細(xì)的布局控制，可以將器件柵格、敷銅柵格、過(guò)...

      2019-04-19 標(biāo)簽：原理圖pcbeda工具 1.2k 0

      在元件封裝選擇元件時(shí)需要考慮哪些問(wèn)題

      確保設(shè)計(jì)具有足夠的旁路電容和地平面。在使用集成電路時(shí)，確保在靠近電源端到地（最好是地平面）的位置使用合適的去耦電容。電容的合適容量取決于具體應(yīng)用、電容技...

      2019-04-20 標(biāo)簽：pcbeda工具元件封裝 2.9k 1

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        Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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        FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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        FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
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        　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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        VHDL代碼
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        面包板
        +關(guān)注
        面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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      • AXI
        AXI
        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
      • 特性阻抗
        特性阻抗
        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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        +關(guān)注
        時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英 晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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        +關(guān)注
        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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        +關(guān)注
        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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