資料介紹
組合邏輯電路(簡(jiǎn)稱(chēng)組合電路)任意時(shí)刻的輸出信號(hào)僅取決于該時(shí)刻的輸入信號(hào),與信號(hào)作用前電路原來(lái)的狀態(tài)無(wú)關(guān)
時(shí)序邏輯電路(簡(jiǎn)稱(chēng)時(shí)序電路)任意時(shí)刻的輸出信號(hào)不僅取決于該時(shí)刻的輸入信號(hào),而且還取決于電路原來(lái)的狀態(tài),即與以前的輸入信號(hào)有關(guān)
組合電路的分析方法和設(shè)計(jì)方法
分析步驟如下:
? (1)從輸入向輸出逐級(jí)推導(dǎo),得到最終的輸出表達(dá)式。
????????? (在這個(gè)過(guò)程中,有時(shí)可以設(shè)幾個(gè)中間變量)
? (2)表達(dá)式化簡(jiǎn)。
? (3)由邏輯表達(dá)式列出真值表。
? (4)由真值表(簡(jiǎn)單邏輯可直接由表達(dá)式)概括出邏輯功能。 (這一步較難)
時(shí)序邏輯電路(簡(jiǎn)稱(chēng)時(shí)序電路)任意時(shí)刻的輸出信號(hào)不僅取決于該時(shí)刻的輸入信號(hào),而且還取決于電路原來(lái)的狀態(tài),即與以前的輸入信號(hào)有關(guān)
組合電路的分析方法和設(shè)計(jì)方法
分析步驟如下:
? (1)從輸入向輸出逐級(jí)推導(dǎo),得到最終的輸出表達(dá)式。
????????? (在這個(gè)過(guò)程中,有時(shí)可以設(shè)幾個(gè)中間變量)
? (2)表達(dá)式化簡(jiǎn)。
? (3)由邏輯表達(dá)式列出真值表。
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