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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>雙2線對4線解碼器/多路分解器數(shù)據(jù)表

      雙2線對4線解碼器/多路分解器數(shù)據(jù)表

      2024-05-13 | pdf | 1.33MB | 次下載 | 免費

      資料介紹

      　　這些肖特基位TTLMSI電路設計用于高性能的存儲解碼或數(shù)據(jù)路由應用程序，需要很短的傳播延遲時間。在高性能存儲器系統(tǒng)中，可以使用這些解碼器將系統(tǒng)解碼的影響降到最低。當采用利用快速使能電路的高速存儲器時，這些解碼器的延遲時間和存儲器的使能時間通常小于存儲器的典型存取時間。

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