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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的改進(jìn)型分組交織器的設(shè)計(jì)與實(shí)現(xiàn)

      基于FPGA的改進(jìn)型分組交織器的設(shè)計(jì)與實(shí)現(xiàn)

      2010-07-28 | rar | 221 | 次下載 | 3積分

      資料介紹

      本文分析了交織器在Turbo碼中的重要作用,以及分組交織器存在的缺陷,提出了一種改進(jìn)型分組交織器的設(shè)計(jì)與實(shí)現(xiàn)方法。該交織器具有算法簡(jiǎn)單、易于實(shí)現(xiàn)、可適應(yīng)不同數(shù)據(jù)幀長(zhǎng)度傳輸要求的優(yōu)點(diǎn)。設(shè)計(jì)采用Altera公司生產(chǎn)的Cyclone系列器件,利用其片內(nèi)RAM實(shí)現(xiàn),并基于QuartusⅡ軟件平臺(tái)進(jìn)行了仿真驗(yàn)證。
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