Vivado HLS 2020.1將是Vivado HLS的最后一個版本,取而代之的是VitisHLS。那么兩者之間有什么區(qū)別呢?
Default User Control Settings
在Vitis HLS下,一個Solution的Flow Target可以是Vivado IP Flow Target,也可以是VitisKernel Flow Target,如下圖所示。前者最終導(dǎo)出來的是VivadoIP,用于支持Vivado IP 設(shè)計流程。后者用于Vitis應(yīng)用加速流程,此時,Vitis HLS會自動推斷接口,無需在代碼里通過Pragma或Directive的方式定義Interface,最終會輸出.xo文件。
User Control Settings還有其他的一些變化,如下表所示。例如,在Vivado HLS下,默認是不會對循環(huán)設(shè)置Pipeline的,但在Vitis HLS下,只要循環(huán)邊界小于64,就會對循環(huán)設(shè)置Pipeline。在Vivado HLS下,默認Clock Uncertainty是時鐘周期的12.5%,但在Vitis HLS下更嚴(yán)格,達到了27%。

對循環(huán)而言,在Vivado HLS下,II(Initial Interval)默認的約束值為1,但在Vitis HLS下,II默認值為auto,意味著工具會盡可能達到最好的II。 目前,針對Vitis HLS,Xilinx已經(jīng)提供了如下文檔和設(shè)計案例: UG1391:Vitis HLSMigration Guide UG1399:VitisHigh-Level Synthesis User Guide Vitis HLS examples: https://github.com/Xilinx/HLS-Tiny-Tutorials
責(zé)任編輯:xj
原文標(biāo)題:Vivado HLS和Vitis HLS什么區(qū)別?
文章出處:【微信公眾號:Lauren的FPGA】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。
-
代碼
+關(guān)注
關(guān)注
30文章
4927瀏覽量
72499 -
Vivado
+關(guān)注
關(guān)注
19文章
844瀏覽量
70294 -
HLS
+關(guān)注
關(guān)注
1文章
133瀏覽量
25441
原文標(biāo)題:Vivado HLS和Vitis HLS什么區(qū)別?
文章出處:【微信號:Lauren_FPGA,微信公眾號:FPGA技術(shù)驛站】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。
發(fā)布評論請先 登錄
CBB82電容和CBB81電容有什么區(qū)別
如何在Unified IDE中創(chuàng)建視覺庫HLS組件
使用AMD Vitis Unified IDE創(chuàng)建HLS組件
如何使用AMD Vitis HLS創(chuàng)建HLS IP
CDS與SDS供液系統(tǒng)兩者之間的區(qū)別
時鐘電路與晶振電路兩者的區(qū)別有哪些
Vivado HLS設(shè)計流程
TXB0104與TXS0102兩者之間有什么區(qū)別嗎?
ADC的接口有Serial SPI和SPI兩種,它們之間有什么區(qū)別?
SD卡座和TF卡座作為電子設(shè)備中的儲存卡槽兩者各有哪些特點
ADC12D1600和ADC12D1600RF這兩種型號之間有什么區(qū)別?
使用HLS流程設(shè)計和驗證圖像信號處理設(shè)備
請問ADC器件的interface中有分為Parallel lvds和serial lvds,請問這兩者有什么區(qū)別?
滲壓計和水位計之間有什么區(qū)別?

Vivado HLS和Vitis HLS 兩者之間有什么區(qū)別
評論